Zoom V3 1612 Bedienungsanleitung Seite 70
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Bewertet. / 5. Basierend auf Kundenbewertungen
BIT1612 10-Bit Digital Video Decoder with OSD and T-CON
60
R_W2_Y 0x124[5:4], 0x123[7:0] RW 10 OSD2 Start Y Position 0x0D2
R_W2_W 0x125[6:0] RW 7 OSD2 Width (in Characters) 0x14
R_W2_H 0x126[5:0] RW 6 OSD2 Height (in Characters) 0x00
OSD0
(0,0)
HSYNC
VSYNC
OSD1
OSD2
R_W0_W
R_W1_W
R_W2_WR_W2_X
R_W1_X
R_W0_X
R_W0_H
R_W1_H
R_W2_H
R_W0_Y
R_W1_Y
R_W2_Y
Figure 6-39 OSD Windows Setup
6.32.2 OSD Memory Mapping
OSD的架構如 Figure 6-39 所示：
使用 R_Wx_INDEXS 和 R_Wx_INDEXE 來指出要由 Display RAM 的第幾個 ”WORD” 開始取 Data (
同時取用 0x5xx 和 0x4xx 相對應的 Data)，其中 0x5xx[6] 用來控制 ”Background Fade Enable” (須搭配
R_Wx_FADE)、0x5xx[5]用來控制 “Foreground Blink Enable” (須搭配 R_Wx_CYCLE)、0x5xx[3:0]用來選
擇 16 個 Palette 中的某一個和 { 0x5xx[4], 0x4xx[6:0] } 用來控制要選取那一個 Font (0x00~0x7F：定義為
“Fixed Font” (128 個) , 0x80~0xAF：定義為 “User Font” (48 個)，和 0xB0~0xBF：定義為 “Color Font” (16
個) )。
另外在Palette RAM部份是以 4 個連續位址當一個屬性，位址 “0” 的 “bit5” 用來控制 “Fringe Enable”
、位址 “0” 的 “bit4” 用來控制 “Foreground Transparent Enable” (等於 1 時，完全透過去)、位址 ”0” 的
”bit3” 用來控制 ”Background Transparent Enable” (等於 1 時，完全透過去)、位址 ”0” 的 ”bit2~0” 及位
址 ”1” 的 ”bit5~0” 用來控制
”Foreground Color”；位址 ”2” 的 ”bit4” 用來控制 ”Foreground Fade
Enable” (須搭配R_Wx_FADE)；位址 ”2” 的 ”bit3” 用來控制 ”Background Blink Enable” (須搭配
R_Wx_CYCLE) 和位址 ”2” 的 ”bit2~0” 及位址 ”3” 的 ”bit5~0” 用來控制”Background Color”，可參考
Figure 6-40 及 Figure 6-41。
而在 ”User Font” 和 ”Color Font” 部份是採用共用RAM的方式來設計，分別有 48 及 16 個Font。在
”User Font” 的部份則是以 32 個RAM位址的Data來組合成一個Font (可參考”
Figure 6-42”)；在 ”Color
Font” 的部份則是以 96 個RAM位址的Data來組合成一個Font (可參考
Figure 6-43)。
- BIT1612 1
- Content 2
- 1 General Description 11
- 2 Features 11
- 3 Order Information 13
- 4 Block Diagram 13
- 5 Pin Definition 14
- 6 Functional Description 18
- 6.4 Pad Type Setup 22
- 6.6 System Enable and Reset 23
- 6.7 Clock Domain Systems 24
- Panel Active Window 26
- Blank Range 26
- HSYNC Output 26
- VSYNC Output 26
- 6.9 Output Data Path 27
- 6.10 Special Output Setup 28
- Input VSYNC 29
- Output VSYNC 29
- 6.12 TCON Function 30
- 6.15 Background 2 33
- 6.17 Auto Blank Screen 34
- Input Image Window 35
- HSYNC Input 35
- VSYNC Input 35
- (Internal VD) 36
- R0 R1 R2 R3 R4 R5 R6 R7 R8 R9 37
- G0 G1 G2 G3 G4 G5 G6 G7 G8 G9 37
- B0 B1 B2 B3 B4 B5 B6 B7 B8 B9 37
- 6.20.7 RGB565 38
- 6.21 Input Mode Selection 39
- Background 41
- 6.24 Scaling Engine 42
- 6.25 Timing Adjustment 45
- Pre-Image Enhancement 46
- Post-Image Enhancement 46
- 6.26.3 Sharpness Process 47
- 6.26.7 LUT Gamma Correction 48
- 6.26.8 Dither 48
- Factor 0x80 49
- 6.27 PWM Function 50
- R_PWM_REF 51
- Base on panel clock 51
- R_PWM_FREQ 51
- R_PWM_DUTY 51
- Base on reference clock 51
- 6.28.5 VBI Data Slicer 55
- 6.28.6 Source Detection 55
- 6.28.7 Luminance Process 56
- 6.28.8 Chroma Process 57
- 6.28.9 Comb Filter Process 58
- 6.28.10 AGC and ACC Process 60
- 6.28.11 AFE and PLL Control 63
- 6.30 Serial RGB Output 68
- 6.31 BIT1690 Interface 68
- 6.32 OSD Function 69
- 6.32.2 OSD Memory Mapping 70
- R_Wx_INDEXS 71
- R_Wx_INDEXE 71
- R_BANK_SEL = 000 72
- If Display RAM 72
- {0x503[4],0x403[6:0]} = 72
- {0x501[4],0x401[6:0]} 73
- R_Wx_INDEX_S 76
- R_OSD_LAYER[2:0] = 001 77
- 6.32.7 OSD Clock Control 79
- 6.33 Timer 80
- 6.34 IR Decoder Function 81
- 6.35 GPI and KEY Function 82
- 6.36 PLL and OSC Pads 82
- 6.37 Auto Detection 83
- 01: From VSYNC1 Pin 85
- 10: From HSYNC2 Pin 85
- 11: From VSYNC2 Pin 85
- 7 User Interface 86
- 7.2.1 Architecture 89
- 7.2.2 Instruction Set 91
- 7.2.3 Start and Interrupt 94
- 7.2.6 Watch Dog Timer 95
- 7.2.8 TWSI Write/Read 96
- 7.2.9 SPI Interface 96
- 7.2.10 Debug Mode 96
- 7.3 Slave Mode 97
- 7.3.2 TWSI Protocol 98
- From Pin 104 Setting 100
- From Pin 105 Setting 100
- 8 Timing Diagram 101
- 9 Electrical Characteristic 103
- 10 Soldering Information 104
- 11 Package Information 105
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