Zoom V3 1612 Bedienungsanleitung Seite 54
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Bewertet. / 5. Basierend auf Kundenbewertungen
BIT1612 10-Bit Digital Video Decoder with OSD and T-CON
44
6.28.4 Synchronization Process
Synchronization Process Block 從 Y/C 分離後的 Luminance 的信號中，分離解出 HSYNC 和 VSYNC
的信號。
SYNC
SLICER
PHASE
DETECTOR
COUNTER
Vertical
Processor
Reference
Clock
Generator
Reference
Clock
HSYNC
VSYNC
LUMA
Figure 6-28 Synchronization Process
Table 6-44 Synchronization Process Register
Mnemonic Address R/W Bits Description Default
R_SYNC_IDEL 0x0B5[7:0] RW 8 Horizontal Increment Delay 0x4A
R_SYNC_HSYS 0x0B6[7:0] RW 8 Horizontal Sync Start 0x2F
R_SYNC_HSYE 0x0B7[7:0] RW 8 Horizontal Sync End 0xFF
R_SYNC_HCS 0x0B8[7:0] RW 8 Clamp Signal Start 0xF2
R_SYNC_HCE 0x0B9[7:0] RW 8 Clamp Signal End 0xC0
R_SYNC_HSS 0x0BA[7:0] RW 8 Horizontal Delay 0xFD
R_BGPU_POINT_N 0x0BB[7:0] RW 8 Burst Start Point for 60Hz Signal 0x06
R_BGPU_POINT_P 0x0BC[7:0] RW 8 Burst Start Point for 50Hz Signal 0x16
R_SLICER_THD 0x0BD[7:0] RW 8 Sync-Slicer Threshold 0x00
VSYNC Noise Reduction Mode
00: Normal Mode
01: Fast Mode
10: Free-Run Mode
R_VNOISE_MODE 0x0BE[1:0] RW 2
11: Bypass Mode
01
R_FIDT_THD 0x0BE[7:4] RW 4 50/60Hz Detection Threshold 0x8
R_SYNC_LPADJ 0x0BF[1:0] RW 2 Loop Filter Tracker Speed 11
R_SYNC_PDGAIN 0x0BF[3:2] RW 2 Loop Filter Phase Tracker Factor 11
R_SYNC_LPLMT 0x0BF[4] RW 1 Loop Filter Phase Adjustment Speed 0
PLL Free-Run Mode Enable
00: Free-Run on 23.928MHz
01: Disable (Normal)
10: Free-Run on 27MHz
R_SYNC_HPLL 0x0BF[6:5] RW 2
11: Free-Run on 30.07MHz
01
VCR Mode Enable
0: Disable
R_VTRC 0x0BF[7] RW 1
1: Enable
0
- BIT1612 1
- Content 2
- 1 General Description 11
- 2 Features 11
- 3 Order Information 13
- 4 Block Diagram 13
- 5 Pin Definition 14
- 6 Functional Description 18
- 6.4 Pad Type Setup 22
- 6.6 System Enable and Reset 23
- 6.7 Clock Domain Systems 24
- Panel Active Window 26
- Blank Range 26
- HSYNC Output 26
- VSYNC Output 26
- 6.9 Output Data Path 27
- 6.10 Special Output Setup 28
- Input VSYNC 29
- Output VSYNC 29
- 6.12 TCON Function 30
- 6.15 Background 2 33
- 6.17 Auto Blank Screen 34
- Input Image Window 35
- HSYNC Input 35
- VSYNC Input 35
- (Internal VD) 36
- R0 R1 R2 R3 R4 R5 R6 R7 R8 R9 37
- G0 G1 G2 G3 G4 G5 G6 G7 G8 G9 37
- B0 B1 B2 B3 B4 B5 B6 B7 B8 B9 37
- 6.20.7 RGB565 38
- 6.21 Input Mode Selection 39
- Background 41
- 6.24 Scaling Engine 42
- 6.25 Timing Adjustment 45
- Pre-Image Enhancement 46
- Post-Image Enhancement 46
- 6.26.3 Sharpness Process 47
- 6.26.7 LUT Gamma Correction 48
- 6.26.8 Dither 48
- Factor 0x80 49
- 6.27 PWM Function 50
- R_PWM_REF 51
- Base on panel clock 51
- R_PWM_FREQ 51
- R_PWM_DUTY 51
- Base on reference clock 51
- 6.28.5 VBI Data Slicer 55
- 6.28.6 Source Detection 55
- 6.28.7 Luminance Process 56
- 6.28.8 Chroma Process 57
- 6.28.9 Comb Filter Process 58
- 6.28.10 AGC and ACC Process 60
- 6.28.11 AFE and PLL Control 63
- 6.30 Serial RGB Output 68
- 6.31 BIT1690 Interface 68
- 6.32 OSD Function 69
- 6.32.2 OSD Memory Mapping 70
- R_Wx_INDEXS 71
- R_Wx_INDEXE 71
- R_BANK_SEL = 000 72
- If Display RAM 72
- {0x503[4],0x403[6:0]} = 72
- {0x501[4],0x401[6:0]} 73
- R_Wx_INDEX_S 76
- R_OSD_LAYER[2:0] = 001 77
- 6.32.7 OSD Clock Control 79
- 6.33 Timer 80
- 6.34 IR Decoder Function 81
- 6.35 GPI and KEY Function 82
- 6.36 PLL and OSC Pads 82
- 6.37 Auto Detection 83
- 01: From VSYNC1 Pin 85
- 10: From HSYNC2 Pin 85
- 11: From VSYNC2 Pin 85
- 7 User Interface 86
- 7.2.1 Architecture 89
- 7.2.2 Instruction Set 91
- 7.2.3 Start and Interrupt 94
- 7.2.6 Watch Dog Timer 95
- 7.2.8 TWSI Write/Read 96
- 7.2.9 SPI Interface 96
- 7.2.10 Debug Mode 96
- 7.3 Slave Mode 97
- 7.3.2 TWSI Protocol 98
- From Pin 104 Setting 100
- From Pin 105 Setting 100
- 8 Timing Diagram 101
- 9 Electrical Characteristic 103
- 10 Soldering Information 104
- 11 Package Information 105
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