Zoom V3 1612 Bedienungsanleitung Seite 39
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Bewertet. / 5. Basierend auf Kundenbewertungen
BIT1612 10-Bit Digital Video Decoder with OSD and T-CON
29
6.21 Input Mode Selection
BIT1612 經由Register設定決定輸入模式，其相關Registers設定，請參考下表，相對應之方塊圖請參考
Figure 6-19。
Table 6-22 Input Mode Selection Register
Mnemonic Address R/W Bits Description Default
External HSYNC Source Selection
0: External HSYNC Pin
R_IHS_SEL 0x04B[0] RW 1
1: Built-in Video Decoder HSYNC
0
External VSYNC Source Selection
0: External VSYNC Pin
R_IVS_SEL 0x04B[1] RW 1
1: Built-in Video Decoder VSYNC
0
R_POL_IHS 0x04B[2] RW 1 External HSYNC polarity Î 0: Normal, 1: Invert 0
R_POL_IVS 0x04B[3] RW 1 External VSYNC polarity Î 0: Normal, 1: Invert 1
EVEN/ODD Signal Selection
00: ITU656-EVEN Signal
01: Visual EVEN/ODD Signal
10: Always EVEN Field
R_SEL_EVEN 0x04B[5:4] RW 2
11: Always ODD Field
00
Sync Mode Selection
0: ITU656 Mode
R_EXT_SYNC 0x04B[6] RW 1
1: From External Sync Pin or Built-In Video
Decoder
0
ITU656 / ITU601 Format Î Data Sequence Shift
Control
X00: No Shift
X01: Shift 1 Clock
X10: Shift 2 Clocks
X11: Shift 3 Clocks
Serial – RGB Format Î Serial-Bus Data Sort
Control
000: Always 0
001: R-G-B
010: R-B-G
011: G-R-B
100: G-B-R
101: B-G-R
110: B-R-G
111: Always 1
RGB 5:6:5 Format Î Data Compensation Mode
X0X: Compensate with R_SORT_656[0].
R_SORT_656 0x04C[6:4] RW 3
X1X: Compensate with LSB Data.
000
Visual EVEN/ODD Mode
0: Normal EVEN/ODD Mode
R_VISUAL_TYPE 0x04C[7] RW 1
1: Always Change by VSYNC
0
Source Format Selection
RGB Domain Source Î R_IMODE= 1
00: Serial-RGB Format
01: RGB 5:6:5 Format
1x: RGB 8:8:8 Format
YUV Domain Source Î R_IMODE = 0
00: ITU656 / ITU656-Like Format
01: ITU601 Format
R_SRC_SEL 0x04D[1:0] RW 2
1x: YUV 4:4:4 Format
00
Swap U and V signal R_SWAP_UV 0x04D[2] RW 1
0: Disable
0
- BIT1612 1
- Content 2
- 1 General Description 11
- 2 Features 11
- 3 Order Information 13
- 4 Block Diagram 13
- 5 Pin Definition 14
- 6 Functional Description 18
- 6.4 Pad Type Setup 22
- 6.6 System Enable and Reset 23
- 6.7 Clock Domain Systems 24
- Panel Active Window 26
- Blank Range 26
- HSYNC Output 26
- VSYNC Output 26
- 6.9 Output Data Path 27
- 6.10 Special Output Setup 28
- Input VSYNC 29
- Output VSYNC 29
- 6.12 TCON Function 30
- 6.15 Background 2 33
- 6.17 Auto Blank Screen 34
- Input Image Window 35
- HSYNC Input 35
- VSYNC Input 35
- (Internal VD) 36
- R0 R1 R2 R3 R4 R5 R6 R7 R8 R9 37
- G0 G1 G2 G3 G4 G5 G6 G7 G8 G9 37
- B0 B1 B2 B3 B4 B5 B6 B7 B8 B9 37
- 6.20.7 RGB565 38
- 6.21 Input Mode Selection 39
- Background 41
- 6.24 Scaling Engine 42
- 6.25 Timing Adjustment 45
- Pre-Image Enhancement 46
- Post-Image Enhancement 46
- 6.26.3 Sharpness Process 47
- 6.26.7 LUT Gamma Correction 48
- 6.26.8 Dither 48
- Factor 0x80 49
- 6.27 PWM Function 50
- R_PWM_REF 51
- Base on panel clock 51
- R_PWM_FREQ 51
- R_PWM_DUTY 51
- Base on reference clock 51
- 6.28.5 VBI Data Slicer 55
- 6.28.6 Source Detection 55
- 6.28.7 Luminance Process 56
- 6.28.8 Chroma Process 57
- 6.28.9 Comb Filter Process 58
- 6.28.10 AGC and ACC Process 60
- 6.28.11 AFE and PLL Control 63
- 6.30 Serial RGB Output 68
- 6.31 BIT1690 Interface 68
- 6.32 OSD Function 69
- 6.32.2 OSD Memory Mapping 70
- R_Wx_INDEXS 71
- R_Wx_INDEXE 71
- R_BANK_SEL = 000 72
- If Display RAM 72
- {0x503[4],0x403[6:0]} = 72
- {0x501[4],0x401[6:0]} 73
- R_Wx_INDEX_S 76
- R_OSD_LAYER[2:0] = 001 77
- 6.32.7 OSD Clock Control 79
- 6.33 Timer 80
- 6.34 IR Decoder Function 81
- 6.35 GPI and KEY Function 82
- 6.36 PLL and OSC Pads 82
- 6.37 Auto Detection 83
- 01: From VSYNC1 Pin 85
- 10: From HSYNC2 Pin 85
- 11: From VSYNC2 Pin 85
- 7 User Interface 86
- 7.2.1 Architecture 89
- 7.2.2 Instruction Set 91
- 7.2.3 Start and Interrupt 94
- 7.2.6 Watch Dog Timer 95
- 7.2.8 TWSI Write/Read 96
- 7.2.9 SPI Interface 96
- 7.2.10 Debug Mode 96
- 7.3 Slave Mode 97
- 7.3.2 TWSI Protocol 98
- From Pin 104 Setting 100
- From Pin 105 Setting 100
- 8 Timing Diagram 101
- 9 Electrical Characteristic 103
- 10 Soldering Information 104
- 11 Package Information 105
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